Intel
Nuovi dettagli sulle cpu Intel Tulsa
di Paolo Corsini pubblicata il 08 Febbraio 2006, alle 15:14 nel canale Private CloudAl debutto nella seconda metà dell'anno le nuove architetture Xeon MP, dotate di una cache di terzo livello condivisa da ben 16 Mbytes
20 Commenti
Gli autori dei commenti, e non la redazione, sono responsabili dei contenuti da loro inseriti - infoQuello che mi lascia perplesso è la quantità di die sprecati dal processo di mascheratura. So che viene effettuato sempre nello stesso modo perché i dischi non sono sempre di uguale diametro, ma non si potrebbe ottimizzare il design volta per volta? Mah...
Non vedo un futuro felice per i nuovi Xeon, sopratutto in vista degli imminenti prodotti della concorrenza da 65nm.
MMMMMiiiiiiiiiiinnnnnnnn.....
......cxxxxxaaaaaa.....ogni volta ci fanno vedere sti "LP", mi viene un coccolone pensando al case......quello che chiedi tu l'lntel lo ha gia fatto negli ultimi anni e le cpu che stai cercando usciranno entro l'anno, queste sono le ultime con tecnologia di derivazione P4
la prossime generazione a leggere le specifiche rese note dovrebbero essere sensibilmente piu performanti ma non rispetto ai p4 attuali ma rispetto alla consorrenza amd (che ovviamente sta già preparando la risposta)
CHissà se questa cache di terzo livello sia effettivamente efficiente...
se non si sprecasse area nel processo di realizzazione e nel taglio dei "die", avresti 72966/435 = circa 167 processori.
Contando quelli sul bordo e quelli che comunque non vengono bene, forse un centinaio o poco più.
Quelli che non vengono bene non si buttano, ma ritornano nel ciclo: il silicio viene depurato e riutilizzato per fare altri wafer. Con quello che costano... non si butta niente!!
per MaxArt:
il processo VIENE ottimizzato ogni volta! Il problema è che il disegno del processore è ogni volta diverso, con diversa area da occupare sul wafer. Stai tranquillo, che l'area sprecata è ridotta quasi a zero (sono soldi che si perderebbero!).
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